EP1K10特點(diǎn)分析與芯片解密

來(lái)源:IC解密、MCU解密服務(wù),依靠多年技術(shù)積累和解密實(shí)踐經(jīng)驗(yàn),能夠?yàn)槊恳豢钚酒峁└咝?、可靠、極具價(jià)格競(jìng)爭(zhēng)優(yōu)勢(shì)和成本控制優(yōu)勢(shì)的解密服務(wù)。
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  關(guān)于EP1K10:
  Altera的ACEX 1K的設(shè)備提供一個(gè)模效率,通過(guò)結(jié)合EABs查找表(LUT)架構(gòu)的低成本架構(gòu)。基于LUT的邏輯提供最佳的數(shù)據(jù)通道的性能和效率,登記密集,數(shù)學(xué),或數(shù)字信號(hào)處理(DSP)的設(shè)計(jì),而EABs實(shí)施的RAM和ROM,雙口RAM,或先入先出(FIFO)功能。這些因素使ACEX 1K的復(fù)雜邏輯功能和記憶功能適合如數(shù)字信號(hào)處理,寬數(shù)據(jù)路徑處理,數(shù)據(jù)轉(zhuǎn)換和微控制器,如高性能通信應(yīng)用的要求??芍貥?gòu)的CMOS SRAM的元素的基礎(chǔ)上,ACEX 1K的架構(gòu)集成了所有必要的功能來(lái)實(shí)現(xiàn)共同的門(mén)陣列宏功能,具有高引腳數(shù),使沿線與系統(tǒng)組件有效的接口。先進(jìn)的工藝和低2.5 V核心電壓要求允許ACEX 1K的設(shè)備,以滿足低成本的要求,大批量應(yīng)用,從DSL調(diào)制解調(diào)器到低成本switches.The ACEX 1K的能力,重新配置設(shè)備實(shí)現(xiàn)完整在發(fā)貨前檢驗(yàn),并允許設(shè)計(jì)者把重點(diǎn)放在模擬和設(shè)計(jì)驗(yàn)證。 ACEX 1K的設(shè)備可重構(gòu)消除庫(kù)存門(mén)陣列設(shè)計(jì)和故障覆蓋率的測(cè)試向量生成的管理。
  EP1K10特點(diǎn):
  可編程邏輯器件(PLD),提供低成本
  系統(tǒng)級(jí)可編程單芯片(SOPC)集成在一個(gè)單一的
  設(shè)備
  - 增強(qiáng)執(zhí)行宏功能的嵌入式陣列
  如高效的內(nèi)存和專(zhuān)門(mén)的邏輯功能
  - 雙端口能力,具有多達(dá)16位嵌入式陣列寬度每
  塊(EAB)
  - 邏輯陣列一般邏輯功能
  高密度
  - 10,000至100,000(見(jiàn)表1)典型的蓋茨
  - 多達(dá)49,152位RAM(4,096位每EAB,所有這些都可以
  使用不降低邏輯能力)
  具有成本效益的可編程架構(gòu)為高容量
  應(yīng)用
  - 成本優(yōu)化的過(guò)程
  - 低高性能的通信成本解決方案
  應(yīng)用
  系統(tǒng)級(jí)功能
  - MultiVoltTM I / O引腳可以驅(qū)動(dòng)或由2.5伏,3.3伏,或驅(qū)動(dòng)
  5.0 - V設(shè)備
  - 低功耗
  - 雙向I / O性能(設(shè)置時(shí)間[臺(tái)聯(lián)黨]和時(shí)鐘tooutput
  延遲高達(dá)250 MHz [噸CO])
  - 完全兼容的外圍組件互連
  特別興趣小組(PCI SIG)的PCI本地總線規(guī)范,
  修訂為3.3 - V的2.2運(yùn)行在33 MHz或66 MHz